MR256D08B
3. TIMING SPECIFICATIONS
Table 3.1 Capacitance 1
Parameter
Address input capacitance
Control input capacitance
Input/Output capacitance
Symbol
C In
C In
C I/O
Typical
-
-
-
Max
6
6
8
Unit
pF
pF
pF
f = 1.0 MHz, V DDQ =V DDQ(typ ), T A  = 25 °C, periodically sampled rather than 100% tested.
Table 3.2 AC Measurement Conditions
Parameter
Logic input timing measurement reference level
Logic output timing measurement reference level
Logic input pulse levels
Output load voltage (V L ) for low & high impedance 
parameters (Figure 3.1)
Output load resistor (R1) for all other timing
Output load resistor (R2) for all other timing
V DDQ =1.8
0.8
0.8
0 or 1.8
0.8
13,500
10,800
V DDQ =2.5
0.8
0.8
0 or 2.5
1.2
16,600
15,400
V DDQ =3.3
0.8
0.8
0 or 3.3
1.75
1,103
1,554
Unit
V
V
V
V
Ω
Ω
Figure 3.1 Output Load Test Low and High
Output
Z D = 50
R L = 50
V L
Figure 3.2 Output Load Test All Others
V DDQ
R1
Output
R2
30 pF
Everspin Technologies       ? 2011
8
MR256D08B Rev. 3, 12/2011
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